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147 __u64 reg_off = id & ~(REG_MASK | KVM_REG_RISCV_CORE); in core_id_to_str()448 case KVM_REG_RISCV_CORE: in print_reg()492 KVM_REG_RISCV | KVM_REG_SIZE_ULONG | KVM_REG_RISCV_CORE | KVM_REG_RISCV_CORE_REG(regs.pc),493 KVM_REG_RISCV | KVM_REG_SIZE_ULONG | KVM_REG_RISCV_CORE | KVM_REG_RISCV_CORE_REG(regs.ra),494 KVM_REG_RISCV | KVM_REG_SIZE_ULONG | KVM_REG_RISCV_CORE | KVM_REG_RISCV_CORE_REG(regs.sp),495 KVM_REG_RISCV | KVM_REG_SIZE_ULONG | KVM_REG_RISCV_CORE | KVM_REG_RISCV_CORE_REG(regs.gp),496 KVM_REG_RISCV | KVM_REG_SIZE_ULONG | KVM_REG_RISCV_CORE | KVM_REG_RISCV_CORE_REG(regs.tp),497 KVM_REG_RISCV | KVM_REG_SIZE_ULONG | KVM_REG_RISCV_CORE | KVM_REG_RISCV_CORE_REG(regs.t0),498 KVM_REG_RISCV | KVM_REG_SIZE_ULONG | KVM_REG_RISCV_CORE | KVM_REG_RISCV_CORE_REG(regs.t1),499 KVM_REG_RISCV | KVM_REG_SIZE_ULONG | KVM_REG_RISCV_CORE | KVM_REG_RISCV_CORE_REG(regs.t2),[all …]
280 KVM_REG_RISCV_CORE); in kvm_riscv_vcpu_get_reg_core()313 KVM_REG_RISCV_CORE); in kvm_riscv_vcpu_set_reg_core()681 u64 reg = KVM_REG_RISCV | size | KVM_REG_RISCV_CORE | i; in copy_core_reg_indices()1000 case KVM_REG_RISCV_CORE: in kvm_riscv_vcpu_set_reg()1031 case KVM_REG_RISCV_CORE: in kvm_riscv_vcpu_get_reg()
29 #define RISCV_CORE_REG(name) __kvm_reg_id(KVM_REG_RISCV_CORE, \
173 #define KVM_REG_RISCV_CORE (0x02 << KVM_REG_RISCV_TYPE_SHIFT) macro