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/glibc-2.36/sysdeps/x86_64/fpu/multiarch/ |
D | svml_s_tanhf16_core_avx512.S | 84 #define _iExpMask 12 macro 125 vpcmpd $6, TANHF_DATA_UNALIGNED(_iExpMask)(%rip){1to16}, %zmm1, %k1 263 __declspec(align(4)) VUINT32 _iExpMask[1][1];
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D | svml_s_coshf16_core_avx512.S | 48 #define _iExpMask 832 macro 125 vpandd _iExpMask+__svml_scosh_data_internal(%rip), %zmm11, %zmm14 259 __declspec(align(64)) VUINT32 _iExpMask[16][1];
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D | svml_d_tanh8_core_avx512.S | 100 #define _iExpMask 2816 macro 171 vpcmpgtd _iExpMask+__svml_dtanh_data_internal(%rip), %ymm7, %ymm6 331 __declspec(align(64)) VUINT32 _iExpMask[16][1];
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D | svml_s_tanhf_rodata.S | 26 #define _iExpMask 128 macro 42 __declspec(align(32)) VUINT32 _iExpMask[8][1];
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D | svml_d_tanh2_core_sse4.S | 79 #define _iExpMask 7728 macro 122 movq _iExpMask+__svml_dtanh_data_internal(%rip), %xmm15 289 __declspec(align(16)) VUINT32 _iExpMask[4][1];
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D | svml_d_tanh4_core_avx2.S | 79 #define _iExpMask 7776 macro 121 vpcmpgtd _iExpMask+__svml_dtanh_data_internal(%rip), %xmm12, %xmm13 296 __declspec(align(32)) VUINT32 _iExpMask[8][1];
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D | svml_s_tanhf4_core_sse4.S | 178 pcmpgtd TANHF_DATA(_iExpMask)(%rip), %xmm8
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D | svml_s_tanhf8_core_avx2.S | 143 vpcmpgtd TANHF_DATA(_iExpMask)(%rip), %ymm4, %ymm15
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