Lines Matching refs:BIT
33 #define MT8195_TOP_AXI_PROT_EN_VDOSYS0 BIT(6)
34 #define MT8195_TOP_AXI_PROT_EN_VPPSYS0 BIT(10)
35 #define MT8195_TOP_AXI_PROT_EN_MFG1 BIT(11)
37 #define MT8195_TOP_AXI_PROT_EN_VPPSYS0_2ND BIT(23)
39 #define MT8195_TOP_AXI_PROT_EN_1_CAM BIT(22)
40 #define MT8195_TOP_AXI_PROT_EN_2_CAM BIT(0)
42 #define MT8195_TOP_AXI_PROT_EN_2_MFG1 BIT(7)
43 #define MT8195_TOP_AXI_PROT_EN_2_AUDIO (BIT(9) | BIT(11))
44 #define MT8195_TOP_AXI_PROT_EN_2_ADSP (BIT(12) | GENMASK(16, 14))
45 #define MT8195_TOP_AXI_PROT_EN_MM_CAM (BIT(0) | BIT(2) | BIT(4))
46 #define MT8195_TOP_AXI_PROT_EN_MM_IPE BIT(1)
47 #define MT8195_TOP_AXI_PROT_EN_MM_IMG BIT(3)
50 #define MT8195_TOP_AXI_PROT_EN_MM_VENC (BIT(9) | BIT(11))
51 #define MT8195_TOP_AXI_PROT_EN_MM_VENC_CORE1 (BIT(10) | BIT(12))
52 #define MT8195_TOP_AXI_PROT_EN_MM_VDEC0 BIT(13)
53 #define MT8195_TOP_AXI_PROT_EN_MM_VDEC1 BIT(14)
54 #define MT8195_TOP_AXI_PROT_EN_MM_VDOSYS1_2ND BIT(22)
55 #define MT8195_TOP_AXI_PROT_EN_MM_VPPSYS1_2ND BIT(23)
56 #define MT8195_TOP_AXI_PROT_EN_MM_CAM_2ND BIT(24)
57 #define MT8195_TOP_AXI_PROT_EN_MM_IMG_2ND BIT(25)
58 #define MT8195_TOP_AXI_PROT_EN_MM_VENC_2ND BIT(26)
59 #define MT8195_TOP_AXI_PROT_EN_MM_WPESYS BIT(27)
60 #define MT8195_TOP_AXI_PROT_EN_MM_VDEC0_2ND BIT(28)
61 #define MT8195_TOP_AXI_PROT_EN_MM_VDEC1_2ND BIT(29)
63 #define MT8195_TOP_AXI_PROT_EN_MM_2_VPPSYS0_2ND (GENMASK(1, 0) | BIT(4) | BIT(11))
64 #define MT8195_TOP_AXI_PROT_EN_MM_2_VENC BIT(2)
65 #define MT8195_TOP_AXI_PROT_EN_MM_2_VENC_CORE1 (BIT(3) | BIT(15))
66 #define MT8195_TOP_AXI_PROT_EN_MM_2_CAM (BIT(5) | BIT(17))
67 #define MT8195_TOP_AXI_PROT_EN_MM_2_VPPSYS1 (GENMASK(7, 6) | BIT(18))
69 #define MT8195_TOP_AXI_PROT_EN_MM_2_VDOSYS1 BIT(10)
70 #define MT8195_TOP_AXI_PROT_EN_MM_2_VDEC2_2ND BIT(12)
71 #define MT8195_TOP_AXI_PROT_EN_MM_2_VDEC0_2ND BIT(13)
72 #define MT8195_TOP_AXI_PROT_EN_MM_2_WPESYS_2ND BIT(14)
73 #define MT8195_TOP_AXI_PROT_EN_MM_2_IPE BIT(16)
74 #define MT8195_TOP_AXI_PROT_EN_MM_2_VDEC2 BIT(21)
75 #define MT8195_TOP_AXI_PROT_EN_MM_2_VDEC0 BIT(22)
77 #define MT8195_TOP_AXI_PROT_EN_VDNR_1_EPD_TX BIT(1)
78 #define MT8195_TOP_AXI_PROT_EN_VDNR_1_DP_TX BIT(2)
79 #define MT8195_TOP_AXI_PROT_EN_VDNR_PCIE_MAC_P0 (BIT(11) | BIT(28))
80 #define MT8195_TOP_AXI_PROT_EN_VDNR_PCIE_MAC_P1 (BIT(12) | BIT(29))
81 #define MT8195_TOP_AXI_PROT_EN_VDNR_1_PCIE_MAC_P0 BIT(13)
82 #define MT8195_TOP_AXI_PROT_EN_VDNR_1_PCIE_MAC_P1 BIT(14)
83 #define MT8195_TOP_AXI_PROT_EN_SUB_INFRA_VDNR_MFG1 (BIT(17) | BIT(19))
84 #define MT8195_TOP_AXI_PROT_EN_SUB_INFRA_VDNR_VPPSYS0 BIT(20)
85 #define MT8195_TOP_AXI_PROT_EN_SUB_INFRA_VDNR_VDOSYS0 BIT(21)
106 #define MT8192_TOP_AXI_PROT_EN_DISP (BIT(6) | BIT(23))
107 #define MT8192_TOP_AXI_PROT_EN_CONN (BIT(13) | BIT(18))
108 #define MT8192_TOP_AXI_PROT_EN_CONN_2ND BIT(14)
110 #define MT8192_TOP_AXI_PROT_EN_1_CONN BIT(10)
111 #define MT8192_TOP_AXI_PROT_EN_1_MFG1 BIT(21)
112 #define MT8192_TOP_AXI_PROT_EN_1_CAM BIT(22)
113 #define MT8192_TOP_AXI_PROT_EN_2_CAM BIT(0)
114 #define MT8192_TOP_AXI_PROT_EN_2_ADSP BIT(3)
115 #define MT8192_TOP_AXI_PROT_EN_2_AUDIO BIT(4)
117 #define MT8192_TOP_AXI_PROT_EN_2_MFG1_2ND BIT(7)
118 #define MT8192_TOP_AXI_PROT_EN_MM_CAM (BIT(0) | BIT(2))
119 #define MT8192_TOP_AXI_PROT_EN_MM_DISP (BIT(0) | BIT(2) | \
120 BIT(10) | BIT(12) | \
121 BIT(14) | BIT(16) | \
122 BIT(24) | BIT(26))
123 #define MT8192_TOP_AXI_PROT_EN_MM_CAM_2ND (BIT(1) | BIT(3))
124 #define MT8192_TOP_AXI_PROT_EN_MM_DISP_2ND (BIT(1) | BIT(3) | \
125 BIT(15) | BIT(17) | \
126 BIT(25) | BIT(27))
127 #define MT8192_TOP_AXI_PROT_EN_MM_ISP2 BIT(14)
128 #define MT8192_TOP_AXI_PROT_EN_MM_ISP2_2ND BIT(15)
129 #define MT8192_TOP_AXI_PROT_EN_MM_IPE BIT(16)
130 #define MT8192_TOP_AXI_PROT_EN_MM_IPE_2ND BIT(17)
131 #define MT8192_TOP_AXI_PROT_EN_MM_VDEC BIT(24)
132 #define MT8192_TOP_AXI_PROT_EN_MM_VDEC_2ND BIT(25)
133 #define MT8192_TOP_AXI_PROT_EN_MM_VENC BIT(26)
134 #define MT8192_TOP_AXI_PROT_EN_MM_VENC_2ND BIT(27)
135 #define MT8192_TOP_AXI_PROT_EN_MM_2_ISP BIT(8)
136 #define MT8192_TOP_AXI_PROT_EN_MM_2_DISP (BIT(8) | BIT(12))
137 #define MT8192_TOP_AXI_PROT_EN_MM_2_ISP_2ND BIT(9)
138 #define MT8192_TOP_AXI_PROT_EN_MM_2_DISP_2ND (BIT(9) | BIT(13))
139 #define MT8192_TOP_AXI_PROT_EN_MM_2_MDP BIT(12)
140 #define MT8192_TOP_AXI_PROT_EN_MM_2_MDP_2ND BIT(13)
141 #define MT8192_TOP_AXI_PROT_EN_VDNR_CAM BIT(21)
159 #define MT8186_TOP_AXI_PROT_EN_MFG1_STEP3 (BIT(25))
160 #define MT8186_TOP_AXI_PROT_EN_1_MFG1_STEP4 (BIT(29))
165 #define MT8186_TOP_AXI_PROT_EN_1_IMG_STEP1 (BIT(23))
166 #define MT8186_TOP_AXI_PROT_EN_1_IMG_STEP2 (BIT(15))
168 #define MT8186_TOP_AXI_PROT_EN_1_IPE_STEP1 (BIT(24))
169 #define MT8186_TOP_AXI_PROT_EN_1_IPE_STEP2 (BIT(16))
174 #define MT8186_TOP_AXI_PROT_EN_1_VENC_STEP1 (BIT(31))
175 #define MT8186_TOP_AXI_PROT_EN_1_VENC_STEP2 (BIT(19))
177 #define MT8186_TOP_AXI_PROT_EN_1_VDEC_STEP1 (BIT(30))
178 #define MT8186_TOP_AXI_PROT_EN_1_VDEC_STEP2 (BIT(17))
180 #define MT8186_TOP_AXI_PROT_EN_2_WPE_STEP1 (BIT(17))
181 #define MT8186_TOP_AXI_PROT_EN_2_WPE_STEP2 (BIT(16))
183 #define MT8186_TOP_AXI_PROT_EN_1_CONN_ON_STEP1 (BIT(18))
184 #define MT8186_TOP_AXI_PROT_EN_CONN_ON_STEP2 (BIT(14))
185 #define MT8186_TOP_AXI_PROT_EN_CONN_ON_STEP3 (BIT(13))
186 #define MT8186_TOP_AXI_PROT_EN_CONN_ON_STEP4 (BIT(16))
204 #define MT8183_TOP_AXI_PROT_EN_DISP (BIT(10) | BIT(11))
205 #define MT8183_TOP_AXI_PROT_EN_CONN (BIT(13) | BIT(14))
206 #define MT8183_TOP_AXI_PROT_EN_MFG (BIT(21) | BIT(22))
207 #define MT8183_TOP_AXI_PROT_EN_CAM BIT(28)
208 #define MT8183_TOP_AXI_PROT_EN_VPU_TOP BIT(27)
209 #define MT8183_TOP_AXI_PROT_EN_1_DISP (BIT(16) | BIT(17))
211 #define MT8183_TOP_AXI_PROT_EN_MM_ISP (BIT(3) | BIT(8))
212 #define MT8183_TOP_AXI_PROT_EN_MM_ISP_2ND BIT(10)
213 #define MT8183_TOP_AXI_PROT_EN_MM_CAM (BIT(4) | BIT(5) | \
214 BIT(9) | BIT(13))
216 BIT(12))
217 #define MT8183_TOP_AXI_PROT_EN_MM_VPU_TOP_2ND (BIT(10) | BIT(11))
218 #define MT8183_TOP_AXI_PROT_EN_MM_CAM_2ND BIT(11)
219 #define MT8183_TOP_AXI_PROT_EN_MCU_VPU_CORE0_2ND (BIT(0) | BIT(2) | \
220 BIT(4))
221 #define MT8183_TOP_AXI_PROT_EN_MCU_VPU_CORE1_2ND (BIT(1) | BIT(3) | \
222 BIT(5))
223 #define MT8183_TOP_AXI_PROT_EN_MCU_VPU_CORE0 BIT(6)
224 #define MT8183_TOP_AXI_PROT_EN_MCU_VPU_CORE1 BIT(7)
231 #define MT8183_SMI_COMMON_SMI_CLAMP_VENC BIT(1)
232 #define MT8183_SMI_COMMON_SMI_CLAMP_ISP BIT(2)
233 #define MT8183_SMI_COMMON_SMI_CLAMP_CAM (BIT(3) | BIT(4))
234 #define MT8183_SMI_COMMON_SMI_CLAMP_VPU_TOP (BIT(5) | BIT(6))
235 #define MT8183_SMI_COMMON_SMI_CLAMP_VDEC BIT(7)
237 #define MT8173_TOP_AXI_PROT_EN_MCI_M2 BIT(0)
238 #define MT8173_TOP_AXI_PROT_EN_MM_M0 BIT(1)
239 #define MT8173_TOP_AXI_PROT_EN_MM_M1 BIT(2)
240 #define MT8173_TOP_AXI_PROT_EN_MMAPB_S BIT(6)
241 #define MT8173_TOP_AXI_PROT_EN_L2C_M2 BIT(9)
242 #define MT8173_TOP_AXI_PROT_EN_L2SS_SMI BIT(11)
243 #define MT8173_TOP_AXI_PROT_EN_L2SS_ADD BIT(12)
244 #define MT8173_TOP_AXI_PROT_EN_CCI_M2 BIT(13)
245 #define MT8173_TOP_AXI_PROT_EN_MFG_S BIT(14)
246 #define MT8173_TOP_AXI_PROT_EN_PERI_M0 BIT(15)
247 #define MT8173_TOP_AXI_PROT_EN_PERI_M1 BIT(16)
248 #define MT8173_TOP_AXI_PROT_EN_DEBUGSYS BIT(17)
249 #define MT8173_TOP_AXI_PROT_EN_CQ_DMA BIT(18)
250 #define MT8173_TOP_AXI_PROT_EN_GCPU BIT(19)
251 #define MT8173_TOP_AXI_PROT_EN_IOMMU BIT(20)
252 #define MT8173_TOP_AXI_PROT_EN_MFG_M0 BIT(21)
253 #define MT8173_TOP_AXI_PROT_EN_MFG_M1 BIT(22)
254 #define MT8173_TOP_AXI_PROT_EN_MFG_SNOOP_OUT BIT(23)
256 #define MT8167_TOP_AXI_PROT_EN_MM_EMI BIT(1)
257 #define MT8167_TOP_AXI_PROT_EN_MCU_MFG BIT(2)
258 #define MT8167_TOP_AXI_PROT_EN_CONN_EMI BIT(4)
259 #define MT8167_TOP_AXI_PROT_EN_MFG_EMI BIT(5)
260 #define MT8167_TOP_AXI_PROT_EN_CONN_MCU BIT(8)
261 #define MT8167_TOP_AXI_PROT_EN_MCU_CONN BIT(9)
262 #define MT8167_TOP_AXI_PROT_EN_MCU_MM BIT(11)
264 #define MT2701_TOP_AXI_PROT_EN_MM_M0 BIT(1)
265 #define MT2701_TOP_AXI_PROT_EN_CONN_M BIT(2)
266 #define MT2701_TOP_AXI_PROT_EN_CONN_S BIT(8)
268 #define MT7622_TOP_AXI_PROT_EN_ETHSYS (BIT(3) | BIT(17))
269 #define MT7622_TOP_AXI_PROT_EN_HIF0 (BIT(24) | BIT(25))
270 #define MT7622_TOP_AXI_PROT_EN_HIF1 (BIT(26) | BIT(27) | \
271 BIT(28))
272 #define MT7622_TOP_AXI_PROT_EN_WB (BIT(2) | BIT(6) | \
273 BIT(7) | BIT(8))
281 #define MT8192_INFRA_CTRL_DISABLE_MFG2ACP BIT(9)
284 #define F_DDR_4GB_SUPPORT_EN BIT(13)